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期刊
High-Level Synthesis of In-Circuit Assertions for Verification, Debugging, and Timing Analysis
John Curreri
;
Greg Stitt
;
Alan D. George
《International Journal of Reconfigurable Computing》
2011卷
(2011/12)
Pp. 131-147
https://doi.org/10.1155/2011/406857
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延伸閱讀
Chen, C. I. (2013).
High-Level Synthesis on Various Distributed Register Architectures
[doctoral dissertation, National Chiao Tung University]. Airiti Library. https://doi.org/10.6842/NCTU.2013.00739
CHANDRASEKHAR, M. S., McCHARLES, R. H., & WALLACE, D. E. (1997).
Effective Coupling between Logic Synthesis and Layout Tools for Synthesis of Area and Speed-Efficient Circuits
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VLSI Design
,
1997
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Wang, H. E. (2016).
String Analysis with Logic Circuit Representation: Theory and Applications
[master's thesis, National Taiwan University]. Airiti Library. https://doi.org/10.6342/NTU201603346
Tsai, T. L. (2016).
String Analysis with Logic Circuit Representation: Implementation and Optimization
[master's thesis, National Taiwan University]. Airiti Library. https://doi.org/10.6342/NTU201603067
Tsai, C. K. (2012).
Static Timing Analysis for Threshold Logic Circuits
[master's thesis, National Tsing Hua University]. Airiti Library. https://www.airitilibrary.com/Article/Detail?DocID=U0016-2002201315384140
國際替代計量
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