雲線式訊號分解之數位電路設計與模擬

A Digital Circuit Design and Simulation of the Spline Decomposition Processing

徐世霖(Shih-Lin Hsu)

指導教授 ： 周復華

健行科技大學/電資學院/電子工程所/碩士(2011年)

https://doi.org/10.6824/UCH.2011.00008

摘要

本論文實際運用現場可程式邏輯閘陣列開發平台實作非線性訊號之經驗模態分解法之數位平行運算電路，系將經驗模態分解之轉移程序的立方雲線插值法實現於現場可程式邏輯閘陣列開發平台。利用現場可程式邏輯閘陣列可進行平行運算之能力加速包絡線之運算，有效縮短情緒化自發性語音分解之運算時間，使原本不具有即時性之經驗模態分解技術能運用於具即時線上要求之語音辨識系統中。雖經數位之硬體電路運算後會造成語音訊號的些許失真，經本論文之實驗證實硬體電路運算所產生之誤差少於2%。
情緒化自發語者辨識技術之架構包括：語音訊號處理，經驗模態分解，特徵萃取，雙模辨識等四大部分。本系統之特色在於藉由立方雲線之數位平行電路加速經驗模態分解過程，並據此建立語者聲學模型與語言詞彙模型。此設計對於要求高度個人化與智慧化的數位家庭生活科技，實為一重要突破。

關鍵字

立方雲線 ； 經驗模態分解 ； 現場可程式邏輯閘陣列 ； 希爾伯特黃轉換

並列摘要

無資料

並列關鍵字

Cubic spline ； Empirical Mode Decomposition ； Field programmable gate array ； Hilbert Huang Transform

參考文獻

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