應用DM642數位信號處理器進行H.264/AVC編碼器之優化與降低復雜度

The Optimization and Complexity Reduction of H.264/AVC Baseline Encoder Using TI DM642 Digital Signal Processor

楊中瑜(Chung-Yu Yang)

指導教授 ： 林道通 ； 莊仁輝 ； 呂嘉榖

國立臺北大學/電機資訊學院/通訊工程研究所/碩士(2008年)

摘要

相較於目前相當普遍的MPEG-2、MPEG-4（此指MPEG4-part2）影音壓縮技術，新一代的H.264/AVC無疑擁有更良好的壓縮比與較低的失真率。但在當前的環境下，H.264的普及率卻不及MPEG-2甚至MPEG-4，主因之ㄧ當然是前述的技術在市場上推廣多年，目前影音設備大多可沿用，另外H.264其強大效能所相對帶來的複雜運算量，壓縮時間亦較難達到即時的運算效果。現今市面上所開發出來能夠即時壓縮的H.264 Encoder產品，其價位較難被一般使用者所接受。在本研究中我們預計採用目前H.264演算法中效能/速度比最佳的X.264為開發基礎，將X.264平台在TI DM642 DSP上實作。在硬體架構的研究當中，TI DM642 DSP本身擁有良好的影像處理效能，妥善規劃記憶體配置並善用硬體指令，在系統架構上，有非常大的優化空間。在軟體上我們結合了多角度的演算法達到最佳化。在現今眾多的嵌入式H.264演算法當中，大部份都是使用硬體實現Codec的方式實作，雖然能得到良好的效能，卻有缺乏更改彈性、成本高、無法置換功能及版本更新不易等缺點。本研究所發展的H.264 Encoder Loopback架構，能在CIF達到real time的效率(超過40 FPS)，VGA解析度達到22.6 FPS的速度，不但兼具上述方式的優點，更有易維護、低成本與多功能的特性，未來擁有無限的衍生應用。

關鍵字

H.264 ； x264 ； motion estimation (ME) ； optimization ； DSP ； DM642

並列摘要

H.264/AVC is the most advanced compression technology which offers better compression ratio and lower distortion than the previous video compression standards such as MPEG-4 and MPEG-2. However, the computational cost is really high. x264 has the best performance/cost time ratio in most of the H.264-based algorithms. The main objective of this thesis is to realize x264 on TI DM642 DSP framework. In this thesis, the complexity will be reduced by using algorithm optimization and programming structure rearrangement. We also optimized part of the encoder with assembly code and new memory arrangement. The proposed and updated codec can achieve the speed of 22.6 FPS for VGA (640£480) size and realtime (more than 40 FPS) for CIF (352£288) size video sequence.

並列關鍵字

H.264 ； x264 ； motion estimation (ME) ； optimization ； DSP ； DM642

參考文獻

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