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學位論文
0.8-4GHz責任週期校正電路在20%-80%校正範圍之設計
Design of a 0.8 GHz-4 GHz Duty-Cycle Corrector Within 20%–80% Correction Range
林建佑(Chien-Yu Lin)
指導教授 :
許恆壽
逢甲大學/資電學院/電子工程學系/碩士(2019年)
https://doi.org/10.6341/fcu.M0626501
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責任週期
;
緩衝器
;
積分器
;
低通濾波器
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Duty Cycle
;
Buffer
;
Integrator
;
low-pass filter
延伸閱讀
吳冠葳(2018)。
0.2-1.8GHz責任週期校正電路之設計
〔碩士論文,逢甲大學〕。華藝線上圖書館。https://doi.org/10.6341/fcu.M0569392
林鈺芬(2008)。
設計於90奈米製程輸出頻率為2.5GHz具快速鎖定之自我校正鎖相迴路
〔碩士論文,國立中央大學〕。華藝線上圖書館。https://www.airitilibrary.com/Article/Detail?DocID=U0031-0207200917351829
徐志杰(2011)。
應用於電源供應器前級之數位控制功率因數校正器之設計
〔碩士論文,國立臺北大學〕。華藝線上圖書館。https://www.airitilibrary.com/Article/Detail?DocID=U0023-0109201113463100
鄧凱駿(2022)。
Design of a 28 GHz Image Rejection Receiver
〔碩士論文,國立臺灣師範大學〕。華藝線上圖書館。https://doi.org/10.6345/NTNU202201613
Yang, H. Y. (2008).
Design and Implementation of 3.1-10.6 GHz UWB, 24-GHz, and 53-GHz CMOS Low Noise Amplifiers
[master's thesis, National Chi Nan University]. Airiti Library. https://doi.org/10.6837/NCNU.2008.00178
國際替代計量
0.8-4GHz責任週期校正電路在20%-80%校正範圍之設計
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