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學位論文
應用於現場可編輯邏輯閘陣列之彈性準循環低密度奇偶檢查編解碼器
Implementation of Flexible QC-LDPC codec on FPGA
侯盈吉(Hou, Ying Chi)
指導教授 :
翁詠祿
國立清華大學/電機資訊學院/電機工程學系/碩士(2015年)
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低密度奇偶檢查碼
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現場可編輯邏輯閘陣列
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彈性準循環編解碼器
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low-density parity-check code
;
FPGA
;
flexible cyclic codec
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延伸閱讀
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適用於非揮發性記憶體系統的可重組化半循環低密度奇偶校驗編解碼器之演算法與硬體架構設計
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應用場規劃邏輯閘陣列於通用序列匯流排資料傳輸之研製
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於現場可程式化邏輯閘陣列設計與實現數位積體電路測試器
〔碩士論文,國立臺灣大學〕。華藝線上圖書館。https://doi.org/10.6342/NTU201901572
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Design and Implementation of 802.16 TPC Decoder with FPGA
〔碩士論文,國立中央大學〕。華藝線上圖書館。https://www.airitilibrary.com/Article/Detail?DocID=U0031-0412201512034271
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