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學位論文
0.2-1.8GHz責任週期校正電路之設計
The Design of 0.2-1.8GHz Duty Cycle Correction Circuit.
吳冠葳(GUAN-WEI WU)
指導教授 :
許恒壽
逢甲大學/資電學院/電子工程學系/碩士(2018年)
https://doi.org/10.6341/fcu.M0569392
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責任週期
;
電荷幫浦
;
延遲級
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Duty Cycle
;
Charge Pump
;
Delay Cell
延伸閱讀
林建佑(2019)。
0.8-4GHz責任週期校正電路在20%-80%校正範圍之設計
〔碩士論文,逢甲大學〕。華藝線上圖書館。https://doi.org/10.6341/fcu.M0626501
林啟超(2008)。
倍數延遲鎖定迴路之寬頻時脈產生器
〔碩士論文,國立臺灣大學〕。華藝線上圖書館。https://doi.org/10.6342/NTU.2008.01157
Mai, W. K. (2009).
頻率合成器之自動校準電路設計
[master's thesis, National Tsing Hua University]. Airiti Library. https://www.airitilibrary.com/Article/Detail?DocID=U0016-0207200916272007
林瑋玲(2016)。
可操作於 1GHz至3GHz之全數位、抗變異、低功耗、高解析度時脈抖動量測電路
〔碩士論文,國立中正大學〕。華藝線上圖書館。https://www.airitilibrary.com/Article/Detail?DocID=U0033-2110201614064855
許佑誠(2001)。
The design of 2.4GHz HBT PA MMIC with bias-cotnrol and power-detector circuit
〔碩士論文,元智大學〕。華藝線上圖書館。https://www.airitilibrary.com/Article/Detail?DocID=U0009-3004200913345778
國際替代計量
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